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陆明哲
责任心不是口号,而是渗透在每个工作细节中的行动准则。
28岁
3年工作经验
13800138000
DB@zjengine.com
陆明哲的照片
求职意向
嵌入式硬件架构师
天津
薪资面谈
随时到岗
工作经历
2022.07 - 2025.06
小楷智联科技
嵌入式硬件架构师

负责工业物联网5G网关硬件架构全周期设计,涵盖SoC/PMIC/射频模块选型、电源/散热/EMC系统级优化及量产可靠性落地,支撑年出货量10万台级产品的技术迭代。

  • 主导7nm制程5G SoC(紫光展锐V510)与RISC-V协处理器的异构架构设计,通过建立功耗-性能模型(基于MATLAB/Simulink),平衡8K视频解码(峰值功耗12W)与待机功耗(<50mW)需求,较上一代架构续航提升40%,支撑工业场景7×24小时连续运行。
  • 设计四层电源树架构(12V输入→3.3V/1.8V/1.2V分层转换),采用TI TPS546D24A同步降压芯片与ADI LTM4644多相电源模块,结合ANSYS SIwave进行电源完整性仿真,优化电容阵列布局(减少30%去耦电容数量),电源转换效率从85%提升至91%,温升降低12℃。
  • 搭建基于Keysight E5080B的EMC预验证平台,针对5G Sub-6GHz射频前端(Qorvo QPM56xx)与数字电路的干扰问题,创新性采用“分区屏蔽+铁氧体磁珠隔离”方案,解决2.4GHz Wi-Fi与5G NR邻频干扰(原测试中-40dBm杂散超标),最终一次性通过CISPR 32 Class B认证(辐射骚扰限值余量8dB)。
  • 推动DFX(可制造性/可测试性设计)流程落地,定义PCB DFM检查项23条(如BGA焊盘间距≥0.3mm)、测试点覆盖率≥90%,联合生产部门优化SMT钢网开口设计,量产首月不良率从3.2%降至1.5%,年度节省返工成本超80万元。
2019.03 - 2022.06
小楷物联技术
高级硬件架构师

聚焦智能家居边缘计算网关硬件架构开发,负责多协议(Zigbee 3.0/蓝牙Mesh/Wi-Fi 6)模块集成、低功耗系统设计及硬件成本优化,支撑产品从0到1落地并实现年销50万台。

  • 主导ARM Cortex-A7(全志H616)+ Cortex-M4双核心架构设计,通过FreeRTOS实时任务调度优化(中断响应时间从20μs缩短至8μs),实现Zigbee 3.0网络(256节点)与Wi-Fi 6(802.11ax)并发接入时延迟≤50ms,满足家庭设备联动实时性要求。
  • 设计动态电压频率调整(DVFS)策略,基于负载监测(ADC采样CPU利用率)自动切换SoC工作模式(满血1.8GHz→节能1.2GHz→深度睡眠200MHz),配合TI TPS62740低功耗DCDC,整机待机功耗从120mW降至45mW,延长电池供电场景(如备用网关)续航至6个月。
  • 解决高频信号串扰问题:针对2.4GHz蓝牙与5GHz Wi-Fi天线共板设计,采用Ansys HFSS仿真天线隔离度(原仅8dB,目标≥15dB),通过调整天线馈点位置(间距从15mm增至25mm)并增加吸波材料,最终隔离度达18dB,丢包率从5%降至0.3%。
  • 主导硬件成本优化项目,通过替换进口晶振(精工爱普生→国产东晶电子)、合并电源芯片(LDO与DCDC二合一)等措施,在性能不变前提下将单台BOM成本从85元降至68元,年降本超1200万元。
2016.07 - 2019.02
小楷电子科技
硬件开发工程师(侧重架构预研)

参与消费级智能音箱硬件开发,负责架构方案预研、关键模块选型验证及早期原型机调试,为后续产品化积累技术储备。

  • 完成智能音箱音频处理架构预研:对比TI TAS5805M(D类功放)与Cirrus Logic CS4278(Codec+独立功放)方案,通过主观听测(10人小组评分)与客观指标(THD+N<0.01%@1W)验证,选定CS4278方案,支撑产品音质达到Hi-Res Audio标准。
  • 设计低延迟音频传输链路:采用I2S接口(采样率48kHz,位宽24bit)连接主控(RK3288)与Codec,配合硬件DMA传输(减少CPU干预),将音频从采集到播放延迟从200ms压缩至50ms,满足语音交互实时唤醒需求。
  • 搭建原型机EMC测试平台:针对喇叭线与电源走线的电磁耦合问题,通过增加地平面隔离(铜箔厚度35μm)、绕制磁珠(100Ω@100MHz)等方式,解决30-100MHz频段辐射超标(原超标10dB),为后续量产版通过FCC认证奠定基础。
  • 主导编写《智能音箱硬件设计规范》(含电源设计/PCB叠层/接口防护3大章节),沉淀12项关键设计规则(如音频走线长度≤500mil),被团队纳入新人培训教材,后续项目设计错误率下降40%。
技能特长
沟通能力
执行能力
热情坦诚
文案能力
兴趣爱好
摄影
看书
阅读
跑步
自我评价
  • 资深嵌入式硬件架构师,深耕电子/通信领域系统级设计,擅长从需求推导顶层架构,提前识别性能、功耗、成本冲突并给最优解,有敏锐技术风险预判力。
  • 秉持“从0到1落地”工程思维,主导过高复杂度硬件平台架构设计,能把抽象需求转可执行路径,确保设计闭环。
  • 跨域协同高效,习惯站软件、结构、供应链视角对齐目标,推动硬件方案兼顾全链路可行性,降后期迭代成本。
  • 技术赋能型架构师,爱沉淀方法论带教团队,助成员快速掌握高复杂度硬件设计核心逻辑。
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