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陆明哲
责任心不是口号,而是渗透在每个工作细节中的行动准则。
28岁
3年工作经验
13800138000
DB@zjengine.com
陆明哲的照片
求职意向
嵌入式硬件架构师
天津
薪资面谈
三个月内到岗
工作经历
2022.07 - 至今
小楷智能物联科技有限公司
嵌入式硬件架构师

负责公司智能物联网终端产品全链路硬件架构设计与落地,涵盖需求分析、多芯片平台选型、系统级验证及跨研发团队(软件/结构/测试)协同,主导构建低功耗、高可靠、可扩展的硬件底层平台。

  • 主导5G+AIoT边缘计算网关硬件架构设计,基于Xilinx Zynq UltraScale+ MPSoC+TI TPS65941电源管理芯片方案,针对多协议(以太网/5G/Wi-Fi 6)并发场景下的散热与电磁兼容难题,创新性采用‘分区热设计+多层PCB叠层优化’策略:通过ANSYS Icepak仿真确定散热片贴合位置,结合10层板(6信号+2电源+2地)设计将核心区域温升控制在45℃以内;同步优化差分对走线阻抗匹配(100Ω±10%),使5G NR空口误码率从1e-9降至1e-12,满足3GPP R16低时延要求。项目支撑公司中标某智慧城市千万级项目,硬件一次流片良率达97%。
  • 牵头建立硬件架构评估体系,引入SystemC TLM 2.0事务级建模与HSPICE联合仿真流程,针对智能传感器节点的多电源域(1.8V/3.3V/5V)交互场景,搭建动态功耗-性能模型。通过该体系提前识别3类电源轨竞争风险(如ADC采样时DDR3L突发读写导致的电压跌落),优化电源路径阻抗(从80mΩ降至45mΩ),使系统动态响应时间缩短20%,架构验证周期从8周压缩至4周,后续项目因架构缺陷导致的返工成本降低55%。
  • 主导低功耗广域网(LPWAN)终端硬件平台升级,对比评估Semtech SX1303与ASR6501芯片方案,最终选定ASR6501+EFM32GG11 MCU组合:通过配置MCU深度睡眠模式(电流<1μA)与SX1303动态时钟门控(唤醒时间<10ms),将终端待机功耗从50μA降至18μA,单节AA电池续航延长至5年(原方案3年)。该平台已量产10万+台,支撑公司在农业环境监测领域市占率提升至15%。
  • 制定《嵌入式硬件架构设计规范V2.0》,覆盖电源完整性(PI)、信号完整性(SI)、EMC/EMI三大核心维度,明确PCB层叠规则(如高速信号层紧邻完整地平面)、去耦电容布局(≤500mil间距)等23项细则。推动团队设计效率提升40%,新员工上手周期从3个月缩短至1个月,近一年项目因架构不规范导致的测试问题减少60%。
2019.03 - 2022.06
小楷电子技术有限公司
高级嵌入式硬件工程师

负责工业级嵌入式设备硬件方案设计与量产导入,聚焦高实时性、多外设扩展及严苛环境适应性需求,支撑PLC控制器、工业网关等产品从原型验证到批量生产的全流程。

  • 主导工业PLC控制器硬件架构升级,基于ST STM32H750 MCU+TI TPS54620电源芯片方案,解决原有平台(STM32F4)在高精度运动控制场景下的实时性瓶颈:通过配置MCU双核心锁步(Cortex-M7@480MHz + Cortex-M4@240MHz),并将运动控制算法(EtherCAT从站协议栈)迁移至M7内核,任务响应时间从10ms缩短至2ms,支持16路CAN FD总线(速率5Mbps)同步通信,产品通过IEC 61131-2工业标准认证,成为公司工业自动化线核心产品。
  • 核心参与车规级车载T-BOX硬件设计,选用NXP S32K144 MCU+ADI ADuM5401数字隔离芯片,针对汽车级可靠性要求(AEC-Q100 Grade 2),优化PCB布局:将晶振远离IGBT模块(温差≤15℃),并在CAN总线接口增加TVS管(钳位电压<30V)。产品通过-40℃~105℃温循测试、15kV ESD接触放电测试,成功配套某新能源车企BMS系统,累计出货8万台。
  • 搭建硬件测试验证平台,引入Keysight E4980AL LCR表(精度0.1%)、Tektronix MSO58示波器(10GHz带宽)及EMC暗室,完成电源纹波(≤50mVp-p)、ESD抗扰度(±8kV接触放电)等12项关键指标测试。制定《硬件测试用例库V1.5》,覆盖10类典型故障场景(如浪涌冲击、电源跌落),量产不良率从3‰降至0.5‰,客户投诉率下降40%。
  • 解决某款工业网关量产阶段的EMI超标问题(原测试值超Class A限值12dB),通过HFSS仿真定位PCB高速信号串扰源(DDR3L与以太网PHY层间距不足),调整层叠为‘信号-地-信号-电源’结构,并在关键走线添加铁氧体磁珠(阻抗100Ω@100MHz),最终EMI余量提升至8dB,顺利完成3C认证。
2016.07 - 2019.02
小楷微电子有限公司
嵌入式硬件开发工程师

参与消费电子类嵌入式产品硬件开发,负责原理图设计、PCB Layout及调试,支撑智能音箱、便携医疗设备等产品的功能实现与量产交付。

  • 负责智能音箱主板硬件开发,基于高通QCC3026蓝牙SoC+ESS Sabre 9018K2M DAC方案,解决蓝牙音频传输底噪问题:通过PCB分区设计(数字区与模拟区间距≥80mil)、电源层分割(LDO供电独立于数字电源),并增加π型滤波电路(电感10μH+电容100nF),将信噪比(SNR)从90dB提升至98dB,用户听感满意度调研得分提高25%,产品上市3个月销量破50万台。
  • 参与便携式血糖仪硬件设计,选用TI MSP430FR6989低功耗MCU,优化外围电路:采用低泄漏电流MOSFET(导通电阻<1Ω)设计采血笔驱动电路,配合软件动态关断非必要模块(如LCD背光),将整机待机功耗降至12mW,续航时间延长至14天(竞品平均10天)。该设计获公司年度技术创新奖,支撑产品进入三甲医院采购目录。
  • 协助解决量产阶段的晶振起振不良问题(不良率5%),通过LCR测试发现晶振负载电容偏差(标称12.5pF,实测11.8pF),调整匹配电容参数(从22pF改为24pF),并优化PCB布局(晶振靠近MCU时钟引脚,走线长度≤500mil),起振不良率降至0.3%,量产交付周期缩短15天。
  • 搭建原型验证平台,使用Saleae逻辑分析仪(16通道)调试I2C通信异常,定位到EEPROM上拉电阻值偏小(原10kΩ→调整为15kΩ),解决数据丢包问题(发生率从0.1%降至0),确保原型机通过客户验收,项目提前2周转量产。
项目经验
2022.03 - 2023.10
星途智联科技有限公司
嵌入式软件研发负责人

5G小基站射频前端智能控制模块开发

  • 项目背景:5G小基站商用面临“频段切换延迟高”“静态校准功耗超标”的核心痛点——传统射频前端模块采用静态参数配置,频段切换需等待80ms以上(超3GPP 10ms要求),且整机功耗较预期高25%。我的核心目标是主导设计智能控制模块,实现射频参数实时自校准与动态功耗优化,支撑小基站达到运营商性能指标。
  • 关键难题:1)5G NR 700MHz-3.5GHz多频段快速切换下,射频参数(如增益、相位误差)的实时感知与精准校准,传统轮询方式延迟高且占用CPU资源;2)低功耗与高性能的矛盾——射频前端模块占总功耗的40%,需动态调整电压/时钟但不能牺牲校准精度;3)嵌入式ARM Cortex-M7内核(512KB RAM)下,复杂算法的轻量化部署。
  • 核心行动:1)针对实时校准,提出“自适应卡尔曼滤波+硬件SPI异步读取”方案——收集120组不同场景(温度、负载)下的射频数据,优化卡尔曼滤波初始协方差矩阵,将参数收敛时间从15ms压缩至3ms;2)设计“功耗预测+动态电压频率调整(DVFS)”机制——用TensorFlow Lite Micro训练轻量化功耗模型(模型大小仅120KB),提前100ms预测业务负载,调整射频模块时钟频率(从80MHz降至40MHz时功耗降低42%);3)搭建双优先级RTOS调度框架,将校准任务设为最高优先级,确保实时性不受其他业务干扰。
  • 项目成果:1)模块性能:频段切换延迟降至12ms(远超3GPP要求),校准精度提升至±0.1dB(较之前提高50%);2)功耗优化:单模块待机功耗从1.2W降至0.78W,整机年省电约150万度(按量产10万台计算);3)商业价值:模块通过运营商入库测试,支撑公司5G小基站产品中标3个省级集采项目,累计出货8万台,我个人主导的算法模块被纳入公司核心技术专利池(已申请2项发明专利)。
2020.06 - 2022.02
星途智联科技有限公司
嵌入式软件高级工程师

工业物联网网关多协议边缘计算固件平台开发

  • 项目背景:公司工业物联网网关此前依赖云端处理设备数据,面临“延迟高(平均500ms)”“云端带宽成本高(占比35%)”的问题。我的角色是负责设计边缘计算固件平台,实现设备数据的本地解析、过滤与简单决策,减少对云端的依赖,支撑网关向“端边云协同”转型。
  • 关键难题:1)多协议兼容的高效处理——网关需支持Modbus RTU/TCP、LoRaWAN、NB-IoT、Zigbee等8种协议,传统“逐个协议硬编码”方式导致解析延迟高(单协议处理需60ms)、代码冗余度高;2)资源受限下的稳定运行——网关采用Cortex-M4内核(256KB RAM),同时运行多个协议栈和边缘算法易导致内存溢出;3)边缘任务的实时性保障——如设备报警需在100ms内响应,不能被低优先级任务阻塞。
  • 核心行动:1)设计“事件驱动+协议抽象层”的多协议融合引擎——定义统一的“协议标识符+数据载荷”格式,将不同协议的解析逻辑封装成可插拔插件(如Modbus插件、LoRa插件),解析延迟降至8ms以内;2)实现“静态内存池+对象复用”机制——针对常用数据结构(如报文头、设备状态)预分配内存池,减少动态内存分配的开销,内存占用降低38%;3)构建分时调度策略——将任务分为“实时(报警处理)”“准实时(数据过滤)”“非实时(日志上报)”三类,用时间片轮转保证实时任务的优先级。
  • 项目成果:1)性能指标:协议处理总延迟从500ms降至90ms以内,报警响应时间稳定在80ms以内;2)资源优化:固件ROM占用从1.2MB降至750KB,支持同时运行5种边缘算法(如设备异常检测、数据聚合);3)商业落地:平台支撑公司3款工业网关产品,累计出货22万台,帮助客户降低65%的云端带宽成本,网关产品线营收同比增长40%,我主导的协议引擎成为公司后续网关产品的标准框架。
技能特长
沟通能力
执行能力
热情坦诚
文案能力
奖项荣誉
  • 计算机技术与软件专业技术资格(水平)证书(嵌入式系统设计师)
  • 2022年度公司项目攻坚奖
  • 2023年电子信息行业协会优秀硬件设计案例奖
自我评价
  • 资深嵌入式硬件架构师,深耕电子/通信领域系统级设计,擅长从需求推导顶层架构,提前识别性能、功耗、成本冲突并给最优解,有敏锐技术风险预判力。
  • 秉持“从0到1落地”工程思维,主导过高复杂度硬件平台架构设计,能把抽象需求转可执行路径,确保设计闭环。
  • 跨域协同高效,习惯站软件、结构、供应链视角对齐目标,推动硬件方案兼顾全链路可行性,降后期迭代成本。
  • 技术赋能型架构师,爱沉淀方法论带教团队,助成员快速掌握高复杂度硬件设计核心逻辑。
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  • 头像
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  • 工作经历
  • 项目经验
  • 实习经验
  • 作品展示
  • 奖项荣誉
  • 校园经历
  • 教育背景
  • 兴趣爱好
  • 技能特长
  • 语言能力
  • 自我评价
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